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자료유형
학술저널
저자정보
박현근 (Sang Myung University) 이광재 (Sang Myung University)
저널정보
대한전기학회 전기학회논문지 P 전기학회논문지 제67P권 제1호
발행연도
2018.3
수록면
9 - 14 (6page)

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In this paper, we introduce an AES-based security chip for the embedded system of Internet of Things(IoT). We used Verilog HDL to implement the AES algorithm in FPGA. The designed AES module creates 128-bit cipher by encrypting 128-bit plain text and vice versa. RTL simulations are performed to verify the AES function and the theory is compared to the results. An FPGA emulation was also performed with 40 types of test sequences using two Altera DE0-Nano-SoC boards. To evaluate the performance of security algorithms, we compared them with AES implemented by software. The processing cycle per data unit of hardware implementation is 3.9 to 7.7 times faster than software implementation. However, there is a possibility that the processing speed grow slower due to the feature of the hardware design. This can be solved by using a pipelined scheme that divides the propagation delay time or by using an ASIC design method. In addition to the AES algorithm designed in this paper, various algorithms such as IPSec can be implemented in hardware. If hardware IP design is set in advance, future IoT applications will be able to improve security strength without time difficulties.
#Security chip #Hardware AES #Field programmable Gate array #Verilog HDL

목차

Abstract
1. 서론
2. 배경지식
3. AES 알고리즘의 하드웨어 구현
4. AES 기반 보안 칩의 성능 분석 및 평가
5. 결론
References

참고문헌 (13)

참고문헌 신청
E. Brown, “Who Needs the Internet of Things?,” linux.com, Oct. 2016. Verizon, “State of the Market : Internet of Things 2017,” Verizon, New York, 2017. M. Hossain et al., “Towards an analysis of security issues, challenges, and open problems in the internet of things,” in 2015 IEEE World Congr. on Services, 2015. M. Popa et al., “Privacy and Security in Connected Vehicles Ecosystems,” Informatica Economica 21.4, pp. 29-40, 2017. C. Wootton, “Samsung ARTIK Reference: The Definitive Developers Guide,” Apress, 2016.

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