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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- Korean Institute of Information Scientists and Engineers Journal of KIISE Journal of KIISE Vol.49 No.1
- 발행연도
- 2022.1
- 수록면
- 15 - 24 (10page)
- DOI
- 10.5626/JOK.2022.49.1.15
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최근 정체되고 있는 기존 컴퓨팅 발전의 한계를 극복하기 위하여 극저온 컴퓨팅이 주목을 받고 있다. 100K 이하의 낮은 온도에서는 컴퓨팅에 유리한 다양한 물성 변화가 나타나므로, 극저온 컴퓨팅은 상온 컴퓨팅보다 더욱 뛰어난 성능 및 전력 효율을 달성할 수 있다. 그러나 실제로 상온 컴퓨팅보다 우월한 극저온 컴퓨팅을 달성하기 위해서는 극저온 환경을 유지하기 위한 냉각 비용을 극복해야 한다. 이는 단순히 상온 컴퓨터를 극저온으로 냉각하는 것만으로는 달성하기 어려우므로, 극저온 환경에서 얻을 수 있는 장점을 최대한 활용할 수 있도록 극저온 컴퓨터를 설계할 필요가 있다. 이 논문은 최근 극저온 컴퓨팅과 관련하여 진행된 연구를 조사하여 정리하였다. 먼저 극저온에서의 반도체 연구를 소개하고, 뒤이어 DRAM, CPU, Flash 등 컴퓨팅 구성 요소들의 극저온 동작 모델링 및 극저온 최적화 연구를 다루었다. 마지막으로, 기존 연구들의 한계 및 향후 극저온 컴퓨팅 연구 방향을 제안한다.
목차
요약
Abstract
1. 서론
2. 배경
3. 극저온 MOSFET 소자 연구
4. 극저온 최적화 컴퓨팅 구성 요소 연구
5. 기존 연구의 한계 및 향후 연구 방향
6. 결론
References
참고문헌 (40)
참고문헌 신청
R. H. Dennard, F. H. Gaensslen, V. L. Rideout, E. Bassous, and A. R. LeBlanc, "Design of ionimplanted MOSFET's with very small physical dimensions," IEEE Journal of Solid-State Circuits, Vol. 9, No. 5, pp. 256-268, Oct. 1974.
R. R. Schaller, "Moore's law: past, present and future," IEEE Spectrum, Vol. 34, No. 6, pp. 52-59, Jun. 1997.
I. Nagaoka, M. Tanaka, K. Inoue, and A. Fujimaki, "A 48GHz 5.6mW Gate-Level-Pipelined Multiplier Using Single-Flux Quantum Logic," 2019 IEEE International Solid-State Circuits Conference, pp. 460-462, 2019.
I. Nagaoka, M. Tanaka, K. Sano, T. Yamashita, A. Fujimaki, and K. Inoue, "Demonstration of an Energy-Efficient, Gate-Level-Pipelined 100 TOPS/W Arithmetic Logic Unit Based on Low-Voltage Rapid Single-Flux-Quantum Logic," 2019 IEEE International Superconductive Electronics Conference, pp. 1-3, 2019.
K. Ishida, I. Byun, I. Nagaoka, K. Fukumitsu, M. Tanaka, S. Kawakami, T. Tanimoto, T. Ono, J. Kim, and K. Inoue, "SuperNPU: An Extremely Fast Neural Processing Unit Using Superconducting Logic Devices," 2020 53rd Annual IEEE/ACM International Symposium on Microarchitecture, pp. 58-72, 2020.
R. R. Schaller, "Moore's law: past, present and future," IEEE Spectrum, Vol. 34, No. 6, pp. 52-59, Jun. 1997.
I. Nagaoka, M. Tanaka, K. Inoue, and A. Fujimaki, "A 48GHz 5.6mW Gate-Level-Pipelined Multiplier Using Single-Flux Quantum Logic," 2019 IEEE International Solid-State Circuits Conference, pp. 460-462, 2019.
I. Nagaoka, M. Tanaka, K. Sano, T. Yamashita, A. Fujimaki, and K. Inoue, "Demonstration of an Energy-Efficient, Gate-Level-Pipelined 100 TOPS/W Arithmetic Logic Unit Based on Low-Voltage Rapid Single-Flux-Quantum Logic," 2019 IEEE International Superconductive Electronics Conference, pp. 1-3, 2019.
K. Ishida, I. Byun, I. Nagaoka, K. Fukumitsu, M. Tanaka, S. Kawakami, T. Tanimoto, T. Ono, J. Kim, and K. Inoue, "SuperNPU: An Extremely Fast Neural Processing Unit Using Superconducting Logic Devices," 2020 53rd Annual IEEE/ACM International Symposium on Microarchitecture, pp. 58-72, 2020.
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